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數字邏輯與數字系統設計(面向新工科普通高等教育系列教材)

作者：編者:袁小平|責編:秦菲//王華慶
出版社：機械工業
ISBN：9787111815976

出版日期：2026/08/01
裝幀：平裝
頁數：209

人民幣：RMB 59 元售價：元

內容大鋼

    本書符合教育部高等學校電工電子基礎課程教學指導分委員會制定的《數字電子技術基礎》課程教學基本要求，在此基礎上引入現代工程上常用的Proteus和FPGA、HDL現代數字電路設計技術，以能力培養為主線，以模塊化知識構建課程體系，以EDA技術為線索，以FPGA為載體，「課程理論基礎知識→門級電路→組合邏輯電路分析與設計→觸發器→時序邏輯電路分析與設計→基於FPGA/HDL的數字系統設計→創新應用性設計→課程設計」的知識結構完整銜接，系統培養學生的數字邏輯思維與數字系統設計、創新實踐能力。
    全書共10章，主要內容包括邏輯代數基礎、邏輯門電路、組合邏輯電路、集成觸發器、時序邏輯電路、脈衝信號的產生與整形、D/A轉換器和A/D轉換器、半導體存儲器與可編程邏輯器件、Verilog HDL及初步應用、數字系統設計案例。本書採用「邏輯→器件→電路→分析→設計」的次序安排教學內容，遵循由淺入深、循序漸進的學習規律，力求通俗易懂，激發讀者學習興趣與主觀能動性。
    本書可作為普通高等學校電氣類、電子信息類、自動化類、電腦類等相關專業「數字電子技術基礎」課程的教材，也可作為從事電子技術工作的工程技術人員的參考書。

作者介紹

編者:袁小平|責編:秦菲//王華慶

前言
第1章邏輯代數基礎
  1.1 概述
    1.1.1 數字信號和數字電路
    1.1.2 數字電路的分類和特點
  1.2 數制與碼制
    1.2.1 數制
    1.2.2 不同數制間的轉換
    1.2.3 二進位代碼
  1.3 邏輯代數
    1.3.1 三種基本的邏輯關係和運算
    1.3.2 邏輯代數的基本運算規律
    1.3.3 邏輯函數及其表示方法
    1.3.4 邏輯函數的公式法化簡
  1.4 邏輯函數的卡諾圖化簡法
    1.4.1 卡諾圖
    1.4.2 用卡諾圖表示邏輯函數
    1.4.3 邏輯函數的卡諾圖化簡
    1.4.4 具有無關項的卡諾圖化簡
  本章小結
  習題及思考題
第2章邏輯門電路
  2.1 分立元器件門電路
    2.1.1 晶體管開關特性
    2.1.2 二極體門電路
    2.1.3 晶體管非門
    2.1.4 MOS管開關特性
  2.2 TTL集成門電路
    2.2.1 TTL與非門
    2.2.2 其他功能的TTL門電路
  2.3 CMOS集成門電路
    2.3.1 CMOS與非門
    2.3.2 CMOS或非門
    2.3.3 CMOS傳輸門和雙向模擬開關
    2.3.4 CMOS電路的實際應用
  2.4 Verilog HDL描述門電路
  本章小結
  習題及思考題
第3章組合邏輯電路
  3.1 組合邏輯電路的分析和設計方法
  3.1.1 組合邏輯電路的分析方法
  3.1.2 組合邏輯電路的設計方法
  3.2 編碼器
    3.2.1 二進位編碼器
    3.2.2 二-十進位編碼器
  3.3 解碼器
    3.3.1 二進位解碼器
    3.3.2 二-十進位解碼器
    3.3.3 數碼顯示解碼器
    3.3.4 用解碼器實現組合邏輯函數

  3.4 數據選擇器和數據分配器
    3.4.1 數據選擇器
    3.4.2 數據分配器
  3.5 加法器
    3.5.1 半加器
    3.5.2 全加器
  3.6 數值比較器
    3.6.1 基本工作原理
    3.6.2 集成數值比較器
    3.6.3 擴展應用
  3.7 組合邏輯電路中的競爭冒險
    3.7.1 競爭冒險現象及其產生的原因
    3.7.2 冒險現象的判別
    3.7.3 消除冒險現象的方法
  3.8 基於Verilog HDL的組合邏輯電路設計
  本章小結
  習題及思考題
第4章集成觸發器
  4.1 集成觸發器的基本形式
    4.1.1 基本RS觸發器
    4.1.2 同步觸發器
  4.2 JK觸發器
  4.3 T觸發器
  4.4 D觸發器
  4.5 常用集成觸發器特性簡介
  4.6 Verilog HDL描述觸發器
  本章小結
  習題及思考題
第5章時序邏輯電路
  5.1 時序邏輯電路基礎
    5.1.1 時序邏輯電路的結構特點
    5.1.2 時序邏輯電路的分類
    5.1.3 時序邏輯電路的狀態圖
  5.2 時序邏輯電路的分析
    5.2.1 同步時序邏輯電路的分析舉例
    5.2.2 非同步時序邏輯電路的分析舉例
  5.3 寄存器和移位寄存器
    5.3.1 寄存器
    5.3.2 移位寄存器
  5.4 計數器
    5.4.1 小規模集成計數器
    5.4.2 中規模集成計數器
  5.5 時序邏輯電路的設計
    5.5.1 時序邏輯電路的設計方法
    5.5.2 採用小規模集成器件
    5.5.3 採用中規模集成器件
    5.5.4 分頻器的設計方法
  5.6 基於Verilog HDL的時序邏輯電路設計
  本章小結
  習題及思考題

第6章脈衝信號的產生與整形
  6.1 施密特觸發器
    6.1.1 用門電路組成的施密特觸發器
    6.1.2 集成施密特觸發器
    6.1.3 施密特觸發器的應用
  6.2 多諧振蕩器
    6.2.1 門電路組成的多諧振蕩器
    6.2.2 石英晶體多諧振蕩器
  6.3 單穩態觸發器
    6.3.1 門電路組成的單穩態觸發器
    6.3.2 集成單穩態觸發器
    6.3.3 單穩態觸發器的應用
  6.4 555定時器及其應用
    6.4.1 555定時器結構及其功能
    6.4.2 555定時器的典型應用
  本章小結
  習題及思考題
第7章 D/A轉換器和A/D轉換器
  7.1 D/A轉換器
    7.1.1 常見的D/A轉換器
    7.1.2 D/A轉換器的主要技術指標
  7.2 A/D轉換器
    7.2.1 A/D轉換器的工作原理
    7.2.2 A/D轉換器的主要技術指標
  本章小結
  習題及思考題
第8章半導體存儲器與可編程邏輯器件
  8.1 只讀存儲器
    8.1.1 ROM的結構框圖
    8.1.2 ROM的工作原理
    8.1.3 ROM的應用舉例
  8.2 隨機存取存儲器
    8.2.1 RAM的結構和工作原理
    8.2.2 2114靜態RAM簡介
  8.3 可編程邏輯器件
    8.3.1 可編程只讀存儲器
    8.3.2 可編程邏輯陣列
    8.3.3 通用陣列邏輯
  本章小結
  習題及思考題
第9章 Verilog HDL及初步應用
  9.1 Verilog HDL設計的基本結構
  9.2 數據類型
  9.3 Verilog HDL中的運算符
  9.4 關鍵字和保留標識符
  9.5 常用語法結構
  9.6 時序邏輯電路
  9.7 狀態機的描述
  本章小結
  習題及思考題

第10章數字系統設計案例
  10.1 傳統數字系統設計方法
    10.1.1 數字系統設計概述
    10.1.2 總體設計
    10.1.3 單元電路及參數確定
    10.1.4 數字電路設計中的若干問題
    10.1.5 總體電路圖的畫法
    10.1.6 安裝調試
  10.2 現代數字系統設計方法
    10.2.1 EDA技術簡介
    10.2.2 EDA技術的基本特徵
    10.2.3 EDA的基本方法
  10.3 交通信號燈控制器設計
    10.3.1 設計任務
    10.3.2 設計思路和原理
    10.3.3 Verilog HDL程序設計
  10.4 基於FPGA技術的曼徹斯特編碼器設計
    10.4.1 研究背景
    10.4.2 曼徹斯特碼的具體應用
    10.4.3 系統的整體設計
  本章小結
  習題及思考題
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