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數字電子技術(普通高等學校電子信息類一流本科專業建設系列教材)

  • 作者：編者:董瑋|責編:潘斯斯
  • 出版社：科學
  • ISBN：9787030773425
  • 出版日期：2023/12/01
  • 裝幀：平裝
  • 頁數：275
人民幣：RMB 69 元      售價：元
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內容大鋼
    本書結合當前數字電子技術的發展，從常用門電路及集成電路晶元著手，對數字電路中常見的典型電路進行詳細解析，全面介紹了數字電子技術中所涉及的各方面知識。主要內容包括：數字邏輯基礎、邏輯門電路、組合邏輯電路、觸發器、時序邏輯電路、脈衝波形的產生和整形電路、半導體存儲器與可編程邏輯器件、數模和模數轉換器、硬體描述語言Verilog HDL等。
    本書可作為普通高等院校電子信息類、自動化類、電腦類各專業本科生的教材，也可供相關科研人員和工程技術人員參考。
作者介紹
編者:董瑋|責編:潘斯斯
目錄
第1章  數字邏輯基礎
  1.1  模擬電路與數字電路
    1.1.1  模擬電路與數字電路的區別
    1.1.2  數字信號的描述方法
    1.1.3  描述脈衝的參數
    1.1.4  數字電路的發展歷程
  1.2  數制
    1.2.1  幾種不同的數制
    1.2.2  不同數制之間的轉換
  1.3  二進位算術運算
    1.3.1  無符號二進位數的四則運算
    1.3.2  原碼、反碼和補碼
    1.3.3  補碼的運算
  1.4  常用的編碼
    1.4.1  自然二進位碼
    1.4.2  二-十進位代碼
    1.4.3  格雷碼
    1.4.4  美國信息交換標準代碼
  1.5  邏輯代數中的運算
    1.5.1  三種基本運算
    1.5.2  複合邏輯運算
  1.6  基本公式和常用公式
    1.6.1  基本公式
    1.6.2  其他常用公式
  1.7  基本定理
    1.7.1  代入定理
    1.7.2  反演定理
    1.7.3  對偶定理
  1.8  邏輯函數及其表示方法
    1.8.1  邏輯函數
    1.8.2  邏輯函數的表示方法
    1.8.3  不同表示方法的相互轉換
  1.9  邏輯函數的兩種標準形式
    1.9.1  最小項
    1.9.2  最大項
    1.9.3  邏輯函數的最小項之和
    1.9.4  邏輯函數的最大項之積
  1.10  邏輯函數的化簡
    1.10.1  邏輯函數的多種表達式
    1.10.2  邏輯函數最簡形式的標準
    1.10.3  邏輯函數的形式變換
    1.10.4  公式化簡法
    1.10.5  卡諾圖化簡法
  1.11  特殊情況的邏輯函數化簡
    1.11.1  含有無關項的邏輯函數化簡
    1.11.2  多輸出邏輯函數的化簡
  本章小結
  習題
第2章  邏輯門電路
  2.1  概述

  2.2  基本CMOS門電路
    2.2.1  MOS管的基本特性
    2.2.2  CMOS反相器
    2.2.3  CMOS與非門
    2.2.4  CMOS或非門
    2.2.5  帶緩衝級的CMOS門電路
  2.3  CMOS門電路的特性參數
    2.3.1  CMOS門電路的靜態特性
    2.3.2  CMOS門電路的動態特性
  2.4  其他類型的CMOS門電路
    2.4.1  漏極開路輸出的CMOS門電路
    2.4.2  三態輸出的CMOS門電路
    2.4.3  CMOS傳輸門
  2.5  常用CMOS門電路系列
  2.6  半導體二極體門電路
    2.6.1  半導體二極體的開關特性
    2.6.2  二極體與門電路
  2.7  TTL門電路
    2.7.1  雙極型三極體反相器
    2.7.2  標準系列的基本TTL門電路
    2.7.3  標準系列TTL門電路的特性及參數
    2.7.4  其他類型的TTL門電路
    2.7.5  其他系列的TTL門電路
  2.8  邏輯門電路使用中的具體問題
    2.8.1  門電路使用中需要注意的問題
    2.8.2  門電路輸入端處理
    2.8.3  不同類型門電路之間的介面問題
  本章小結
  習題
第3章  組合邏輯電路
  3.1  概述
    3.1.1  組合邏輯電路的定義
    3.1.2  組合邏輯電路的描述方法
  3.2  組合邏輯電路的分析方法
  3.3  組合邏輯電路的設計方法
  3.4  若干典型的組合邏輯電路
    3.4.1  加法器
    3.4.2  數值比較器
    3.4.3  編碼器
    3.4.4  解碼器
    3.4.5  數據選擇器
  3.5  組合邏輯電路中的競爭冒險現象
    3.5.1  競爭冒險現象產生原因及判斷方法
    3.5.2  消除競爭冒險現象的方法
  本章小結
  習題
第4章  觸發器
  4.1  概述
  4.2  鎖存器和觸發器
    4.2.1  RS鎖存器

    4.2.2  電平觸發的觸發器
    4.2.3  脈衝觸發的觸發器
    4.2.4  邊沿觸發的觸發器
  4.3  觸發器的邏輯功能
    4.3.1  RS觸發器
    4.3.2  D觸發器
    4.3.3  JK觸發器
    4.3.4  T觸發器
    4.3.5  各種功能觸發器之間的轉換
  4.4  觸發器的動態特性
  本章小結
  習題
第5章  時序邏輯電路
  5.1  概述
  5.2  時序邏輯電路的分析方法
    5.2.1  同步時序邏輯電路的分析方法
    5.2.2  非同步時序邏輯電路的分析方法
  5.3  基本寄存器和移位寄存器
    5.3.1  基本寄存器
    5.3.2  移位寄存器
  5.4  計數器
    5.4.1  計數器的分類
    5.4.2  同步計數器
    5.4.3  非同步計數器
    5.4.4  任意進位計數器
  5.5  常用的時序邏輯電路
    5.5.1  移位寄存器型計數器
    5.5.2  序列信號發生器
  5.6  時序邏輯電路的設計方法
    5.6.1  同步時序邏輯電路的設計方法
    5.6.2  時序邏輯電路的自啟動設計
  本章小結
  習題
第6章  脈衝波形的產生和整形電路
  6.1  概述
  6.2  脈衝波形的產生電路
    6.2.1  TTL門電路構成的對稱式多諧振蕩電路
    6.2.2  環形振蕩電路
    6.2.3  石英晶體多諧振蕩電路
  6.3  脈衝波形的整形電路
    6.3.1  施密特觸發電路
    6.3.2  單穩態觸發電路
  6.4  555定時器及其應用
    6.4.1  555定時器的電路結構與功能
    6.4.2  555定時器實現施密特觸發電路
    6.4.3  555定時器實現單穩態觸發電路
    6.4.4  555定時器實現的多諧振蕩電路
  本章小結
  習題
第7章  半導體存儲器與可編程邏輯器件

  7.1  概述
  7.2  半導體存儲器的結構
  7.3  半導體存儲器的性能指標
  7.4  半導體存儲器的分類
    7.4.1  只讀存儲器
    7.4.2  隨機訪問存儲器
  7.5  存儲器擴展
  7.6  可編程邏輯器件
    7.6.1  可編程只讀存儲器
    7.6.2  可編程陣列邏輯
    7.6.3  通用陣列邏輯
  7.7  高密度可編程邏輯器件
    7.7.1  複雜可編程邏輯器件
    7.7.2  現場可編程門陣列
  7.8  FPGA產品簡介
    7.8.1  AMD公司的FPGA產品
    7.8.2  Intel公司的FPGA產品
    7.8.3  Lattice公司的FPGA產品
    7.8.4  國產FPGA產品
  本章小結
  習題
第8章  數模和模數轉換器
  8.1  概述
  8.2  D/A轉換器
    8.2.1  權電阻網路D/A轉換器
    8.2.2  倒T形電阻網路D/A轉換器
    8.2.3  權電流型D/A轉換器
    8.2.4  D/A轉換器的雙極性輸出方式
    8.2.5  集成D/A轉換器
  8.3  D/A轉換器的技術指標
    8.3.1  D/A轉換器的解析度
    8.3.2  D/A轉換器的轉換誤差
    8.3.3  D/A轉換器的轉換速度
  8.4  D/A轉換器的應用
  8.5  A/D轉換器
    8.5.1  A/D轉換器的基本原理
    8.5.2  常見的A/D轉換器
    8.5.3  集成A/D轉換器
    8.5.4  A/D轉換器的技術指標
  本章小結
  習題
第9章  硬體描述語言Verilog HDL
  9.1  概述
  9.2  Verilog HDL語言要素
    9.2.1  標識符與關鍵字
    9.2.2  常量及其表示
    9.2.3  變數
    9.2.4  運算符
    9.2.5  Verilog HDL程序的基本結構
    9.2.6  行為描述語句

  9.3  Verilog HDL描述門電路
  9.4  Verilog HDL描述組合邏輯電路
  9.5  Verilog HDL描述觸發器
  9.6  Verilog HDL描述時序邏輯電路
    9.6.1  Verilog HDL層次化的設計方法
    9.6.2  有限狀態機的設計
  本章小結
  習題
參考文獻

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