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EDA技術及VHDL程序設計(高等院校互聯網+新形態創新系列教材)/電腦系列

  • 作者：編者:李翠錦//武麗莉//余曉玫|責編:孟攀
  • 出版社：清華大學
  • ISBN：9787302622680
  • 出版日期：2022/12/01
  • 裝幀：平裝
  • 頁數：224
人民幣：RMB 49 元      售價：元
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內容大鋼
    本書吸收了近年來的最新理論研究成果，同時緊密聯繫EDA技術設計流程及晶元設計的最新動態，通過介紹大量的工程案例，突出內容詮釋上的深入淺出，使學生在掌握專業理論知識的同時，提高晶元設計分析與操作的實際技能。
    本書共分為8章，內容包括EDA技術概述、EDA設計開發工具、VHDL語言編程基礎、組合邏輯電路的設計、時序邏輯電路的設計、Quartus Ⅱ軟體中的宏模塊、EDA設計模擬及EDA設計綜合實例。
    本書既可以作為高等院校電子信息類專業的教材，也可以作為電子設計從業者的參考用書。
作者介紹
編者:李翠錦//武麗莉//余曉玫|責編:孟攀
目錄
第1章  EDA技術概述
  1.1  EDA產品的發展歷程
  1.2  EDA技術與ASIC設計
  1.3  EDA技術工作原理
    1.3.1  EDA技術的基本特點
    1.3.2  EDA配置模式
  1.4  EDA設計流程與設計方法
    1.4.1  關鍵步驟的實現
    1.4.2  自項向下和自底向上
    1.4.3  基於IP核的設計
  1.5  主要EDA廠家
  1.6  EDA的應用
  1.7  EDA技術
第2章  EDA設計開發工具
  2.1  ModelSim軟體使用方法
    2.1.1  ModelSim軟體安裝
    2.1.2  ModelSim模擬方法
    2.1.3  ModelSim模擬步驟
    2.1.4  ModelSim模擬波形
  2.2  Quartus Ⅱ軟體使用方法
    2.2.1  Quartus Ⅱ設計流程
    2.2.2  Quartus Ⅱ軟體安裝
    2.2.3  USB-Blaster驅動安裝
    2.2.4  Quartus Ⅱ設計步驟
  3.1  概述
    3.1.1  VHDL的特點
    3.1.2  VHDL與Verilog、ABEL語言的比較
    3.1.3  關於VHDL的學習
  3.2  基本結構
    3.2.1  實體
    3.2.2  結構體
    3.2.3  進程
    3.2.4  子程序
    3.2.5  庫
  3.3  語言要素
    3.3.1  文字規則
    3.3.2  數據對象
    3.3.3  數據類型
    3.3.4  操作符
  3.4  順序語句
    3.4.1  賦值語句
    3.4.2  流程式控制制語句
    3.4.3  WAIT語句
    3.4.4  返回語句
    3.4.5  空操作語句
    3.4.6  子程序調用語句
  3.5  並行語句
第4章  組合邏輯電路的設計
  4.1  VHDL的描述風格
  4.2  優先編碼器

  4.3  解碼器
  4.4  數值比較器
  4.5  數據選擇器
  4.6  三態門電路
  4.7  組合邏輯電路中的競爭與冒險
第5章  時序邏輯電路的設計
  5.1  概述
  5.2  時鐘信號的VHDL描述方法
    5.2.1  時鐘邊沿的描述
    5.2.2  時序電路中的進程敏感信號
  5.3  時序電路中複位信號的VHDL描述方法
    5.3.1  同步複位
    5.3.2  非同步複位
  5.4  D觸發器
    5.4.1  基本D觸發器
    5.4.2  非同步清零邊沿D觸發器
  5.5  計數器
    5.5.1  基本同步計數器
    5.5.2  具有複位埠的同步計數器
    5.5.3  具有同步置數埠的同步計數器
  5.6  鎖存器
  5.7  寄存器
    5.7.1  基本寄存器
    5.7.2  移位寄存器
  5.8  存儲器
    5.8.1  ROM只讀存儲器
    5.8.2  RAM隨機存儲器
    5.8.3  FIFO存儲器
  5.9  有限狀態機的設計
    5.9.1  有限狀態機的定義
    5.9.2  狀態機的結構及分類
    5.9.3  狀態機的設計步驟
    5.9.4  Moore型狀態機
    5.9.5  Mealy型狀態機
  5.10  時序邏輯電路設計實例
第6章  Quartus Ⅱ軟體中的宏模塊
  6.1  megafunction庫
    6.1.1  算術運算模塊庫
    6.1.2  邏輯門庫
    6.1.3  I/O模塊庫
    6.1.4  存儲模塊庫
  6.2  maxplus2庫
    6.2.1  時序電路宏模塊
    6.2.2  運算電路宏模塊
  6.3  primitives庫
    6.3.1  存儲單元庫
    6.3.2  邏輯門庫
    6.3.3  緩衝器庫
    6.3.4  引腳庫
    6.3.5  其他模塊

第7章  EDA設計模擬
  7.1  模擬的概念
    7.1.1  模擬簡介
    7.1.2  模擬的切入點
  7.2  Testbench的基本概念
  7.3  簡單Testbench的搭建
    7.3.1  Testbench的基本格式
    7.3.2  自動生成Testbench模板
    7.3.3  激勵信號的產生
    7.3.4  模擬響應
    7.3.5  自動驗證
    7.3.6  自我檢查
    7.3.7  編寫Testbench的準則
  7.4  應用ModelSim軟體模擬實例
第8章  EDA設計綜合實例
  8.1  基於VHDL格雷碼編碼器的設計
    8.1.1  實驗目的
    8.1.2  實驗原理
    8.1.3  實驗內容
    8.1.4  實驗步驟
    8.1.5  實驗現象與結果
    8.1.6  實驗報告
    8.1.71  程序
  8.2  基本觸發器的設計
    8.2.1  實驗目的
    8.2.2  實驗原理
    8.2.3  實驗內容
    8.2.4  實驗步驟
    8.2.5  實驗現象與結果
    8.2.6  實驗報告
    8.2.7  主程序
  8.3  七人表決器的設計
    8.3.1  實驗目的
    8.3.2  實驗原理
    8.3.3  實驗內容
    8.3.4  實驗步驟
    8.3.5  實驗結果與現象
    8.3.6  實驗報告
    8.3.7  主程序
  8.4  四人搶答器的設計
    8.4.1  實驗目的
    8.4.2  實驗原理
    8.4.3  實驗內容
    8.4.4  實驗步驟
    8.4.5  實驗結果與現象
    8.4.6  實驗報告
    8.4.7  主程序
  8.5  8位七段數碼管動態顯示電路的設計
    8.5.1  實驗目的
    8.5.2  實驗原理

    8.5.3  實驗內容
    8.5.4  實驗步驟
    8.5.5  實驗現象與結果
    8.5.6  實驗報告
    8.5.7  主程序
  8.6  直流電機測速實驗
    8.6.1  實驗目的
    8.6.2  實驗原理
    8.6.3  實驗內容
    8.6.4  實驗步驟
    8.6.5  實驗結果與現象
    8.6.6  實驗報告
    8.6.7  主程序
  8.7  交通信號燈控制電路實驗
    8.7.1  實驗目的
    8.7.2  實驗原理
    8.7.3  實驗內容
    8.7.4  實驗步驟
    8.7.5  實驗結果與現象
    8.7.6  實驗報告
    8.7.7  主程序
    8.8.6  租車計費器的設計
    8.8.1  實驗目的
    8.8.2  實驗原理
    8.8.3  實驗內容
    8.8.4  實驗步驟
    8.8.5  實驗結果與現象
    8.8.6  實驗報告
    8.8.7  主程序

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