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基於QuartusⅡ的數字邏輯實驗手冊/新工科大數據專業群實踐叢書

  • 作者：編者:欒嵐|責編:雷紅娟
  • 出版社：武漢理工
  • ISBN：9787562964957
  • 出版日期：2021/10/01
  • 裝幀：活頁
  • 頁數：70
人民幣：RMB 38 元      售價：元
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內容大鋼
    本書從可編程器件、EDA軟體和硬體描述語言的現代數字系統的設計方法出發，內容涵蓋兩大部分：Quartus Ⅱ的原理圖設計、Quartus Ⅱ的文本設計。全書共包含9個實驗，分別為：集成邏輯門的邏輯功能測試以及Quartus Ⅱ的基本使用、組合邏輯電路的原理圖設計、8-3編碼器的Verilog設計與實現、3-8解碼器的Verilog設計與應用、數據選擇器的Verilog設計及Symbol的生成、組合邏輯電路的Verilog 設計、D觸發器的Veri-log設計、4位二進位加減法計數器的Verilog設計、基於狀態機的數字系統綜合設計。
    本書可作為電腦學科、電子技術學科的數字邏輯、數字電路相關本科課程的實驗教材，也可作為工程技術人員的參考書目。
作者介紹
編者:欒嵐|責編:雷紅娟
目錄
實驗一  集成邏輯門的邏輯功能測試以及QuartusⅡ的基本使用
  一、實驗目的
  二、實驗原理
  三、實驗設備
  四、實驗內容及實驗步驟
  五、實驗總結
實驗二  組合邏輯電路的原理圖設計
  一、實驗目的
  二、實驗原理
  三、實驗設備
  四、實驗內容及實驗步驟
  五、實驗總結
實驗三  8-3編碼器的Verilog設計與實現
  一、實驗目的
  二、實驗環境
  三、實驗內容
  四、實驗原理
  五、實驗步驟
  六、實驗總結
實驗四  3-8解碼器的Verilog 設計與應用
  一、實驗目的
  二、實驗環境
  三、實驗內容
  四、實驗原理
  五、實驗步驟
  六、實驗總結
實驗五  數據選擇器的Verilog設計及Symbol的生成
  一、實驗目的
  二、實驗環境
  三、實驗內容
  四、實驗原理
  五、實驗步驟
  六、思考練習
實驗六  組合邏輯電路的Verilog 設計
  一、實驗目的
  二、實驗環境
  三、實驗內容
  四、實驗步驟
  五、實驗總結
實驗七  D觸發器的Verilog設計
  一、實驗目的
  二、實驗環境
  三、實驗內容
  四、實驗原理
  五、實驗步驟
  六、實驗總結
  七、思考練習
實驗八  4位二進位加減法計數器的Verilog設計
  一、實驗目的
  二、實驗環境

  三、實驗內容
  四、實驗原理
  五、實驗步驟
  六、實驗總結
  七、思考練習
實驗九  基於狀態機的數字系統綜合設計
  一、實驗目的
  二、實驗環境
  三、實驗內容
  四、實驗總結
附錄A  Verilog簡明教程
附錄B  下載至FPGA晶元時要注意的問題
附錄C  實驗報告要求
附錄D  部分參考程序

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