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數字邏輯與數字系統(第6版新工科建設電腦類系列教材普通高等教育十一五國家級規劃教材)

  • 作者：編者:李景宏//王永軍//李晶皎//楊丹//李景華|責編:冉哲
  • 出版社：電子工業
  • ISBN：9787121434303
  • 出版日期：2022/05/01
  • 裝幀：平裝
  • 頁數：268
人民幣：RMB 55 元      售價：元
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內容大鋼
    本書在普通高等教育「十一五」國家級規劃教材和國家精品課程教材《數字邏輯與數字系統》（第5版）基礎上，依照2019年出版的《高等學校工科基礎課程教學基本要求彙編》，為適應數字電子技術的不斷發展和應用水平的不斷提高修訂而成。全書共9章，內容包括數字邏輯基礎、邏輯門電路、組合邏輯電路、鎖存器和觸發器、時序邏輯電路、半導體存儲器、脈衝波形的產生與整形、數模轉換和模數轉換、數字系統分析與設計等。附錄包括CPLD和FPGA簡介、電氣簡圖用圖形符號二進位邏輯元件簡介、常用邏輯符號對照表等實用內容。本書提供多媒體課件，登錄華信教育資源網（www.hxedu.com.cn）註冊后免費下載。
    本書為電子信息類各專業平台課程教材，可作為高校電腦、通信、電子、電氣及自動化等專業本科生教材，還可供自學考試、成人教育和電子工程技術人員自學使用。
作者介紹
編者:李景宏//王永軍//李晶皎//楊丹//李景華|責編:冉哲
目錄
第1章  數字邏輯基礎
  1.1  計數體制
    1.1.1  十進位數
    1.1.2  二進位數
    1.1.3  八進位數和十六進位數
    1.1.4  數制間的轉換
  1.2  常用編碼
    1.2.1  二-十進位編碼(BCD碼)
    1.2.2  循環碼
    1.2.3  ASCII碼
  1.3  邏輯代數基礎
    1.3.1  邏輯變數和邏輯函數
    1.3.2  基本邏輯運算及基本邏輯門
    1.3.3  邏輯代數的基本公式和常用公式
    1.3.4  邏輯函數的表示方法
    1.3.5  邏輯函數的化簡
  習題
第2章  邏輯門電路
  2.1  概述
  2.2  CMOS門電路
    2.2.1  MOS管的開關模型
    2.2.2  CMOS反相器的電路結構和工作原理
    2.2.3  CMOS反相器的傳輸特性曲線和抗干擾能力
    2.2.4  CMOS反相器的輸入特性曲線和輸出特性曲線
    2.2.5  CMOS反相器的動態特性
    2.2.6  與非門
    2.2.7  或非門
  2.3  其他類型的CMOS門電路及參數
    2.3.1  三態門
    2.3.2  CMOS傳輸門
    2.3.3  漏極開路門（OD門）
    2.3.4  低電壓CMOS門電路
    2.3.5  CMOS門電路主要性能參數
  2.4  TTL門電路
    2.4.1  雙極型三極體的開關特性
    2.4.2  TTL與非門的電路結構和工作原理
    2.4.3  TTL與非門電路特性曲線
    2.4.4  TTL門電路主要性能參數
  2.5  ECL門電路
    2.5.1  ECL門電路工作原理
    2.5.2  ECL門電路主要特點
  2.6  Bi-CMOS門電路
    2.6.1  Bi-CMOS門電路工作原理
    2.6.2  Bi-CMOS門電路主要性能參數
  2.7  數字電路使用中應注意的問題
    2.7.1  CMOS門電路使用中應注意的問題
    2.7.2  TTL門電路使用中應注意的問題
    2.7.3  數字電路介面
  習題
第3章  組合邏輯電路

  3.1  組合邏輯電路的特點
  3.2  小規模集成電路構成的組合邏輯電路的分析與設計
    3.2.1  分析方法
    3.2.2  設計方法
  3.3  編碼器
    3.3.1  二進位編碼器
    3.3.2  優先編碼器
  3.4  解碼器
    3.4.1  二進位解碼器
    3.4.2  二-十進位解碼器
    3.4.3  半導體數碼管和七段字形解碼器
  3.5  數據分配器與數據選擇器
    3.5.1  數據分配器
    3.5.2  數據選擇器
  3.6  數值比較電路
  3.7  算術運算電路
    3.7.1  二進位加法電路
    3.7.2  二進位減法電路
    3.7.3  算術邏輯單元
  3.8  奇偶校驗電路
    3.8.1  奇偶校驗的基本原理
    3.8.2  中規模集成奇偶發生器/校驗器
  3.9  中規模集成電路構成的組合邏輯電路的設計
  3.10  組合邏輯電路中的競爭-冒險
    3.10.1  競爭-冒險的產生
    3.10.2  競爭-冒險的判斷
    3.10.3  競爭-冒險的消除
  3.11  用硬體描述語言設計組合邏輯電路
    3.11.1  可編程邏輯器件的表示方法及組合模式
    3.11.2  硬體描述語言Verilog HDL基礎
    3.11.3  用Verilog HDL實現組合邏輯電路的設計
  習題
第4章  鎖存器和觸發器
  4.1  鎖存器
    4.1.1  閂鎖電路及基本SR鎖存器
    4.1.2  門控SR鎖存器
    4.1.3  D鎖存器
  4.2  觸發器
    4.2.1  主從D觸發器
    4.2.2  邊沿觸發JK觸發器
    4.2.3  維持阻塞D觸發器
  4.3  其他功能的觸發器
  4.4  觸發器邏輯功能的轉換
  習題
第5章  時序邏輯電路
  5.1  時序邏輯電路的特點和表示方法
    5.1.1  時序邏輯電路的特點
    5.1.2  時序邏輯電路的表示方法
  5.2  時序邏輯電路的分析方法
  5.3  寄存器

    5.3.1  數碼寄存器
    5.3.2  移位寄存器
  5.4  計數器
    5.4.1  計數器分類
    5.4.2  二進位計數器
    5.4.3  十進位計數器
    5.4.4  可逆計數器
    5.4.5  中規模集成計數器構成的任意進位計數器
    5.4.6  移位寄存器型計數器
  5.5  順序脈衝發生器
  5.6  時序邏輯電路的設計方法
  5.7  用硬體描述語言設計時序邏輯電路
    5.7.1  可編程邏輯器件時序模式
    5.7.2  用Verilog HDL實現時序邏輯電路的設計
  習題
第6章  半導體存儲器
  6.1  概述
    6.1.1  半導體存儲器的特點及分類
    6.1.2  半導體存儲器的技術指標
  6.2  只讀存儲器
    6.2.1  固定只讀存儲器
    6.2.2  可編程只讀存儲器
    6.2.3  可擦可編程只讀存儲器
  6.3  隨機存取存儲器
    6.3.1  靜態RAM
    6.3.2  動態RAM
    6.3.3  集成RAM簡介
    6.3.4  RAM的擴展
  習題
第7章  脈衝波形的產生與整形
  7.1  集成555定時器及其應用
    7.1.1  電路組成和工作原理
    7.1.2  集成555定時器的應用
  7.2  門電路構成的矩形波發生器與整形電路
    7.2.1  多諧振蕩器
    7.2.2  單穩態電路
    7.2.3  施密特觸發電路
  習題
第8章  數模轉換和模數轉換
  8.1  數模轉換器(DAC)
    8.1.1  二進位權電阻DAC
    8.1.2  R-2R倒T型電阻網路DAC
    8.1.3  DAC的主要技術指標
    8.1.4  集成DAC舉例
    8.1.5  DAC應用舉例
  8.2  模數轉換器(ADC)
    8.2.1  幾個基本概念
    8.2.2  並行比較ADC
    8.2.3  反饋比較ADC
    8.2.4  雙積分型ADC

    8.2.5  ADC的主要技術指標
    8.2.6  集成ADC舉例
    8.2.7  ADC應用舉例
  習題
第9章  數字系統分析與設計
  9.1  數字系統概述
  9.2  數字系統設計語言——寄存器傳送語言
    9.2.1  基本語句
    9.2.2  設計舉例
  9.3  簡易電腦的功能分析與電路設計
    9.3.1  簡易電腦的基本結構
    9.3.2  簡易電腦框圖設計
    9.3.3  簡易電腦控制器設計
    9.3.4  簡易電腦部件邏輯設計
    9.3.5  簡易電腦的實現
  習題
附錄A  CPLD和FPGA簡介
  A.1  CPLD
  A.2  FPGA
  A.3  可編程邏輯器件開發的一般步驟
附錄B  《電氣簡圖用圖形符號第12部分：二進位邏輯元件》(GB/T 4728.12-2008)簡介
  B.1  符號的構成
  B.2  邏輯約定
  B.3  各種限定符號
  B.4  關聯標注法
  B.5  常用器件符號示例
附錄C  常用邏輯符號對照表
參考文獻

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