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信號完整性(深入理解高速數字電路設計)/清華開發者書庫

作者：編者:高曉宇|責編:盛東亮//鍾志芳
出版社：清華大學
ISBN：9787302558286

出版日期：2020/11/01
裝幀：平裝
頁數：356

人民幣：RMB 89 元售價：元

內容大鋼

本書基於作者從事信號完整性技術研究和工程設計實踐的經驗積累寫作而成，闡述從事高速數字電路設計所必需的信號完整性基礎理論和設計知識，包括了解基本概念、問題成因，理解分析方法，設計應對措施和了解技術演進歷程等。主要內容有：信號完整性問題出現的技術背景、傳輸線與阻抗基礎理論、信號的傳輸與迴流、反射與端接技術、數字集成電路基礎、信號完整性模擬與模型、時延與時序、電源完整性和高速串列介面技術。
本書可作為廣大信號完整性初學者的導引入門技術教程，讀者通過本書可快速構建信號完整性的基礎知識體系，掌握信號完整性的基本設計理念。本書也可供從事信號完整性和高速電路相關產品開發設計的工程技術人員（包括電路設計工程師、Layout工程師、SI模擬工程師和電路測試工程師等）作為學習讀物和設計指導手冊，同時可作為信號完整性相關專業研究人員和在校學生的參考學習資料。

作者介紹

編者:高曉宇|責編:盛東亮//鍾志芳
高曉宇，畢業於西南交通大學通信工程專業，現就職于中國電子科技集團西南通信研究所。從事通信技術研究與產品研發工作近二十年，先後完成多種類型高性能網路通信電子產品的開發。擅長複雜、高速數字電路系統的設計，在信號完整性與高速電路設計領域具有豐富的設計經驗。

第1章  信號完整性的由來
  1.1  引言
  1.2  邏輯波形和實際波形
  1.3  頻率提升帶來的改變
  1.4  信號完整性問題的本質起因
第2章  信號與連接
  2.1  電路實現的實質內容
  2.2  連接對信號波形的影響
  2.3  信號的傳輸過程
第3章  傳輸線與阻抗
  3.1  傳輸線的構成
  3.2  傳輸線阻抗
第4章  反射
  4.1  反射發生的原理
  4.2  末端端接
  4.3  反射導致的波形變化
第5章  傳輸線建模與設計
  5.1  傳輸線模型
  5.2  電感
  5.3  傳輸線上的電感
  5.4  均勻傳輸線
  5.5  50Ω的來歷
  5.6  阻抗與印製電路板疊層
第6章  信號電流
  6.1  表層信號的迴流路徑
  6.2  內層信號的迴流路徑
  6.3  阻抗與信號電流
  6.4  信號電流與傳輸線阻抗的主次考量
  6.5  信號電流的路徑選擇性
  6.6  信號電流的「變化」本質
第7章  分散式系統
  7.1  分散式系統的內涵
  7.2  傳輸線的「長短」
  7.3  源端端接
第8章  數字集成電路
  8.1  外觀和內貌
  8.2  MOS晶體管
  8.3  CMOS反相器
  8.4  I-V特性曲線
  8.5  動態特性
  8.6  從10μmm到10nm
第9章  模擬與模型
  9.1  模擬
  9.2  SPICE模型
  9.3  IBIS模型的源起
  9.4  Buffer的含義
  9.5  IBIS模型詳解——輸出Buffer
  9.6  IBIS模型詳解——輸入Buffer
  9.7  IBIS模型詳解——其他Buffer類型
第10章  時延與時序

  10.1  時延對時序的影響
  10.2  信號的傳輸速度
  10.3  時鐘的不同供給方式
第11章  電源完整性
  11.1  電源完整性問題一
  11.2  電源完整性問題二
  11.3  旁路電容
第12章  高速串列介面
  12.1  技術演進之路
  12.2  從單端到差分
  12.3  LVDS收發電路
  12.4  差分信號的傳輸線阻抗
  12.5  SerDes
  12.6  眼圖
  12.7  損耗
參考文獻

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